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verilog-axi 是用 Verilog 编写的开源项目，主题标签有限，建议打开仓库查看具体用途。
Verilog AXI components for FPGA implementation
hw 是用 Verilog 编写的开源项目，主题标签有限，建议打开仓库查看具体用途。
目前累计 2.2k star、662 fork，主要语言为 Verilog，项目始于 2017 年，采用 NOASSERTION 许可。最近状态：已有一段时间未更新。适合：正在做技术选型的开发者。
中文介绍优先采用本站人工维护条目；无维护条目时依据 GitHub 公开字段（语言、主题、星标、提交时间）自动生成，未经项目方确认，不构成选型结论。nvdla/hw 是一个以 Verilog 为主的开源项目，目前累计 2.2k star、662 fork，较长时间未更新。项目未标注主题标签。
依据 GitHub 公开字段（语言、主题、星标、提交时间）自动生成，未经人工逐项核实。无主题标签
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