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Wren6991 / Hazard3

Hazard3

3-stage RV32IMACZb* processor with debug

Verilog★ 1.1k⑂ 97Apache-2.0创建于 2021-05-22最近提交 2026-08-29
中文介绍 · 自动生成

Hazard3 是用 Verilog 编写的开源项目,主题标签有限,建议打开仓库查看具体用途。

目前累计 1.1k star、97 fork,主要语言为 Verilog,项目始于 2021 年,采用 Apache-2.0 许可。最近状态:近半年有提交。适合:正在做技术选型的开发者。

中文介绍优先采用本站人工维护条目;无维护条目时依据 GitHub 公开字段(语言、主题、星标、提交时间)自动生成,未经项目方确认,不构成选型结论。
一句话解读

Wren6991/Hazard3 是一个以 Verilog 为主的开源项目,目前累计 1.1k star、97 fork,近半年有提交。主要方向:jtag、risc-v、riscv。

依据 GitHub 公开字段(语言、主题、星标、提交时间)自动生成,未经人工逐项核实。
jtagrisc-vriscv

README

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